数据采集逻辑原理图/电路图

数据采集逻辑原理图/电路图

数据采集逻辑原理图/电路图

CY7C68013中文资料pdf  

本系统的具体和详细设计如图2所示的数据采集逻辑原理图。在图2中， 图像采集处理芯片用OV7620/7120，时钟频率为27MHz，像素时钟为27MHz；CPU控制和USB2.0接口芯片用CY7C68013，时钟频率为24MHz，通过对CY7C68013内部的CPUCS寄存器进行修改，使其工作在48MHz方式下。根据芯片OV7620/7120 及CY7C68013 内部的FIFO、通用编程接口等特点， 其具体接法是： 将OV7620/7120 的像素时钟PCLK接到CY7C68013的IFCLK上；OV7620/7120的HREF、VSYNC分别接到CY7C68013的RDY0、RDY1上；同时将OV76 20 / 7 12 0 的VSYNC、CHSYNC 分别接到CY7C68013 的INT0、INT1 上。将CY7C68013 的PE0、PE1接在OV7620/7120 的I2C BUS 上。