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运算放大器电路中固有噪声的分析与测量
我们可将噪声定义为电子系统中任何不需要的信号。噪声会导致音频信号质量下降以及精确测量方面的错误。板级与系统级电子设计工程师希望能确定其设计方案在最差条件下的噪声到底有多大，并找到降低噪声的方法以及准确
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基于DSP的嵌入式以太网接口转换器
引言许多测量和控制设备都是通过串口与其他设备通信，使设备间的数据交互和远程控制受到限制。如果能把串口的数据转换成网络数据格式，组建一个局域网(LAN)来进行数据的交互与传输，则上述的限制将得到有效的改
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ZLG7290在智能仪表面板接口设计中的应用
1引言I2C总线接口的显示及键盘管理器件ZLG7290广泛应用于智能仪表的接口设计当中，在具体应用过程中，它接收所要显示的数据并将其显示在LED显示器上，动态地扫描管理着显示过程，该器件本身只需2根线
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车辆底盘集中润滑系统智能控制器的设计
众所周知，汽车上运动部件的润滑是决定汽车运行工况和部件使用寿命的一个极其重要的因素。如果运动部件得不到及时和适当的润滑就会被磨损坏，导致汽车无法正常工作；而润滑供油过量也会产生附加热量，造成污染和浪费
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基于智能传感器NPX的气体状态监控系统
有关在电力系统中的电厂、变电站实现无人值守的设想很早就提出了，而单片机技术使得在线监测广泛应用于电力系统中的各个环节，为无人值守提供了技术上支持。通过总线通信技术，使工作人员在办公室能够利用后台服务程
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TMS320F28xx DSP中内部Flash的应用研究
1前言TMS320F28xxDSP片内有128K×16bit字的Flash、两块4Kx16bit字的单周期访问RAM(SARAM)LO和L1、一块8Kxl6bit字的单周期访问RAM(SARAM)HO
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MPEG算法在列车运行监控系统中的应用
列车运行监控记录装置已在铁路的安全运输过程中发挥了巨大的作用，其不足之处是没有音频、语音记录功能。为了解决这个问题，按照铁道部的技术要求，研究开发了一种新型列车音频、语音记录设备。该设备主要用于协同监
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生成有效的板支持包
具有嵌入式处理器的平台FPGA为您提供前所未有的灵活性、集成度和高性能。目前，在单个可编程逻辑设备中开发极其复杂且高度定制化的嵌入式系统已成为可能。随着芯片性能的不断增加，如何使设计方法始终高效、多产
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基于SRAM/DRAM的大容量FIFO的设计与实现
1引言FIFO(FirstInFirstOut)是一种具有先进先出存储功能的部件。在高速数字系统当中通常用作数据缓存。在高速数据采集、传输和实时显示控制领域中．往往需要对大量数据进行快速存储和读取，而
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利用Virtex-5 FPGA实现更高的性能
在FPGA系统设计中，要达到性能最大化需要平衡具有混合性能效率的元器件，包括逻辑构造(fabric)、片上存储器、DSP和I/O带宽。在本文中，我将向你解释怎样能在追求更高系统级性能的过程中受益于Xi
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基于梯形图-VHDL的CPLD开发方法研究
摘要：本文对直接采用CPLD器件设计顺序控制逻辑电路时设计效率不高的问题进行了分析，提出了将梯形图工具与VHDL程序相结合的设计方法以提高设计效率，并研究了用VHDL语言实现梯形图的方法。设计实例证明
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多规格S盒的硬件实现方法
内容预览：摘要：本文用VHDL硬件描述语言实现了1个多规格S盒，兼容1组8×8规格的S盒和4组6×4规格的S盒。通过改变控制编码，它可以实现8×8和6×4规格的任意布尔函数变化，可以满足DES算法和A
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基于OpenVera构建以太网MAC芯片验证平台
引言当芯片的设计规模越来越大，朝向SoC发展时，RTL级功能仿真时间还可以忍受，但门级仿真己经成为不可能继续广泛使用的技术了。对设计进行完备性验证要求有足够的测试向量，随着设计规模的增大，需要的仿真向
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LCoS彩色时序控制器的ASIC设计
内容预览：摘要：本文介绍了LCoS彩色时序控制器的原理和实现方法，采用全定制设计技术进行了该控制器电路的ASIC芯片设计，该芯片功能正确，功耗较低，可靠性强。引言基于头盔显示器对便携性的要求，要实现微
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视频分配器中提高信号完整性的方法
摘要：本文通过对信号完整性问题产生机理的分析，提出了一系列的解决方案。针对一个小型的VGA分配器的设计，结合合理的仿真模型说明了确保良好信号完整性是高速电子系统实现的保证。引言处理高速电子系统的信号完
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模块级验证环境在顶层验证中的复用
内容预览：摘要：模块级验证环境在顶层验证中的复用可以有效地提高生产率，利用Synopsys先进的NTB验证语言可以方便地实现验证环境复用。本文介绍了验证环境复用的方法，并通过一个实例说明了验证环境复用
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使用方便的12V恒流充电器
笔者在维修一台6511心电图机时，其故障原因是机内充电电池充不上电(本机用的是12V／2．0Ah充电电池)。为此，笔者设计了一种采用VMOS功率场电器对心电图机电池大电流短时间(一般不超过10分钟)充
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一种改进的Wallace树型乘法器的设计
摘要：对Booth算法产生的部分积重新合理分组，采用CSA和4-2压缩器的混合电路结构，对传统的Wallace树型乘法器进行改进，提出一种高速的树型乘法器。该结构与传统Wallace树型乘法器相比，具
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2006 CDN Live! 硅谷大会掠影
现在，随着芯片设计复杂性的增加，以及制造技术向65nm及以下工艺的快速发展，设计师正面临着一系列不断出现的、更加严峻的设计挑战。因此,他们也就越加关心如何更好地运用EDA技术来解决通信、计算机及消费类
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基于Astro工具的ASIC时序分析
PerformTimingAralysisinASICDesignUsingAstro摘要：在目前的ASIC设计中，时钟信号的质量对同步数字电路的影响越来越大。如何避免时序问题给电路造成的不利影响成为
