Altera公开20－nm创新技术
9月7日消息，Altera公司昨日公开了在其下一代20-nm产品中规划的几项关键创新技术。Altera在20
nm的体系结构、软件和工艺的创新，能支持更强大的混合系统架构的开发，带来性能、带宽、集成度和功效的新的提升。
Altera的20-nm混合系统架构包括40-Gbps收发器技术、下一代精度可调数字信号处理(DSP)模块体系结构以提供高达5 TFLOP（每秒5万亿次浮点运算）的IEEE 754标准浮点运算性能、异质混合3D IC技术即通过创新的高速互联接口来集成FPGA和用户可定制HardCopy? ASIC，或者集成包括存储器、第三方ASIC、光接口等在内的各种技术。Altera是业界唯一能够在一个器件中集成FPGA和ASIC的公司。
20-nm混合系统架构在功耗管理方面继续创新，包括自适应电压调整、可编程功耗技术、以及工艺技术优化等，使得Altera器件功耗比前一代降低了60%。
异质混合20-nm系统的开发通过全功能高级设计环境得以实现，这一设计环境包括系统集成工具(Qsys)、基于C的设计工具(OpenCL?)以及DSP开发软件(DSP Builder)。Altera持续关注通过增强其开发工具以在20nm实现业界最快的编译时间，来提高设计人员的效能。
Altera下一代器件采用TSMC的20-nm工艺技术和业界最高的系统集成度，并包括硬核ARM?处理器子系统。20-nm 片上系统(SoC) FPGA为客户提供了从28-nm到20-nm的软件移植途径，同时将处理器子系统的性能提高了50%。
即将实现的创新包括：
最高串行带宽：40-Gbps芯片至芯片和28-Gbps背板收发器
具有高速芯片至芯片接口的异质混合3D IC
业界性能最好的DSP，带来最高TFLOP/W
Altera在20-nm器件刷新了业界的TFLOP/W基准。下一代精度可调DSP模块增强技术实现了5 TFLOP（每秒5万亿次浮点运算）的IEEE 754标准浮点运算性能。在此性能水平上，Altera 20-nm器件的每瓦TFLOP要比竞争FPGA高5倍。结合了最具效能的OpenCL C设计流程、ARM硬核处理器子系统以及最高的TFLOP/W的硅片效率，Altera的20-nm器件提供了终极异质混合计算平台。
Altera目前正在与客户沟通20-nm产品，并与客户共同讨论产品的发展路线。（责编：陶圆秀）
Altera的20-nm混合系统架构包括40-Gbps收发器技术、下一代精度可调数字信号处理(DSP)模块体系结构以提供高达5 TFLOP（每秒5万亿次浮点运算）的IEEE 754标准浮点运算性能、异质混合3D IC技术即通过创新的高速互联接口来集成FPGA和用户可定制HardCopy? ASIC，或者集成包括存储器、第三方ASIC、光接口等在内的各种技术。Altera是业界唯一能够在一个器件中集成FPGA和ASIC的公司。
20-nm混合系统架构在功耗管理方面继续创新，包括自适应电压调整、可编程功耗技术、以及工艺技术优化等，使得Altera器件功耗比前一代降低了60%。
异质混合20-nm系统的开发通过全功能高级设计环境得以实现，这一设计环境包括系统集成工具(Qsys)、基于C的设计工具(OpenCL?)以及DSP开发软件(DSP Builder)。Altera持续关注通过增强其开发工具以在20nm实现业界最快的编译时间，来提高设计人员的效能。
Altera下一代器件采用TSMC的20-nm工艺技术和业界最高的系统集成度，并包括硬核ARM?处理器子系统。20-nm 片上系统(SoC) FPGA为客户提供了从28-nm到20-nm的软件移植途径，同时将处理器子系统的性能提高了50%。
即将实现的创新包括：
最高串行带宽：40-Gbps芯片至芯片和28-Gbps背板收发器
具有高速芯片至芯片接口的异质混合3D IC
业界性能最好的DSP，带来最高TFLOP/W
Altera在20-nm器件刷新了业界的TFLOP/W基准。下一代精度可调DSP模块增强技术实现了5 TFLOP（每秒5万亿次浮点运算）的IEEE 754标准浮点运算性能。在此性能水平上，Altera 20-nm器件的每瓦TFLOP要比竞争FPGA高5倍。结合了最具效能的OpenCL C设计流程、ARM硬核处理器子系统以及最高的TFLOP/W的硅片效率，Altera的20-nm器件提供了终极异质混合计算平台。
Altera目前正在与客户沟通20-nm产品，并与客户共同讨论产品的发展路线。（责编：陶圆秀）