数字时钟设计电路图汇总（七款数字时钟电路图）

　　数字时钟设计电路图（一）

　　本设计主要采用中断的方式，采用INT0，INT1中断，分别由按键s1，s2触发。按键s1作为功能选择键，当按键s1按下时，可以在不同的功能之间进行切换。按下s1，由时钟状态进入秒表状态，再按一下，秒表开始计时，再按s1，秒表停下，再按s1，进入调整时钟的状态，每按一次，可以用按键s2对相应的位进行调整。其中复位电路具有上电自动复位，和手动复位功能。由P2控制三极管驱动数码管，P0口做数据输出口。

　　数字时钟设计电路图（二）

　　校“时”和校“分”的校准电路是相同的，现以校“分”电路来说明时间的校准。（www、t262、com） 在正常计时时，与非门U2D的一个输入端为1，将它开通，使秒计数器输出的分脉冲加到U2D的另一输入端，并经U1D进入分计数器。而此时U3D由于一个输入端为0，因此被关断，校准用的秒脉冲进不去。

　　在校“分”时，按下开关J1，情况与上述情况适反。U2D被封闭，U3D打开，标准秒脉冲直接进入分计数器进行快速校“分”。同理，在校“时”时，按下开关，标准秒脉冲直接进入时计数器进行快速校“时”。可见U1D、U2D、U3D构成的是一个二选一电路。

　　数字时钟设计电路图（三）

　　由图可以看出，当“时”个位U8计数输入端到第10个触发信号时，U8计数器复零，进位端QD向U7“时”十位计数器输出进位信号，当第24个“时”（来自“分”计数器输出的进位信号）脉冲到达时，U8计数器的状态为“0100”，U7计数器的状态为“0010”，此时“时”个位计数器的QC和“时”十位计数器的QB输出为“1”。把他们分别送入U7、U8计数器的清零端R01和R02，通过74LS290内部的R01和R02与非 13

　　数字时钟设计电路图（四）

　　数字钟的计数电路是用两个六十进制计数电路和一个十二进制计数电路实现的，但是考虑到对74LS90比较熟悉，觉得用两个74LS90来分别控制秒和分的十位和个位。个位采用十进制，十位采用六进制就能完美解决六十进制的秒计数。然后再用74ls191和74ls74来分别控制时的个位和十位。