使用用CPLD和Flash实现FPGA的配置

使用用CPLD和Flash实现FPGA的配置

2 具体设计

　　国家数字交换系统工程技术研究中心承担的国家863项目高性能IPv6核心路由器采用一片Intel E28F128J3A150 16位Flash作为BootFlash对PowerPC2860(MPC860)处理机进行加电配置下载更新的方案，其多余的存储空间完全可以存放下FPGA所需的配置文件。加电复位、系统启动后，由处理机与一片XilinxXC95288XL CPLD配合，控制FPGA配置文件从Flash下载到FPGA中，完成对FPGA的配置。860处理机支持网络功能，当配置文件需要更新时，可通过网络将新的配置文件发送到处理机，然后再由处理机更新系统中的Flash。采用XC95288CPLD配置FPGA的具体电路设计结构如图2所示。

　　图2中，CPLD主要功能是把从Flash中读出的数据转换成串行输出，然后再将地址递增。CCLK(信号由CPU时钟产生。PROG信号则由CPU输出的地址数据经译码模块产生。XC95288C PLD逻辑结构如图3所示。